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DSP解密:TMS320VC5407

提供TI TMS320VC5407解密服务,仅限学习、研究等合法用途,解密热线:13810019655 010-62245566

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TMS320VC5407特性如下,详细资料见TMS320VC5407.pdf
• 先进的多总线架构,三个独立的16位数据存储器总线和一个程序存储器总线
• 40位算术逻辑单元(ALU),包括40位的桶形移位器和两个独立的40位累加器
• 17 – × 17位并行乘法器加上一个40位专用加法器的非流水线单周期乘法/累加(MAC)的操作
• 比较,选择和存储单元(CSSU)为新增/比较维特比运营商选择
• 指数编码器计算在一个周期内的一个40位累加器的价值指数值
• 八两个辅助寄存器和两个辅助地址发生器寄存器算术单元(ARAUs)
• 数据总线和一个公交持有人特征

• 扩展寻址模式800万× 16位最大可寻址外部程序空间
• 片内ROM
 - 128K× 16位(5407)程序存储器配置
 - 64K× 16位(5404)程序存储器配置
• 片内RAM
 - 40K× 16位(5407)五个为8K × 16位片上双访问程序块组合/数据RAM
 - 16K × 16位(5404)的两个为8K × 16位片上双访问程序块组合/数据RAM
• 增强外部并行接口(XIO2)
• 单指令重复和块重复操作的程序代码
• 为更好的方案和数据管理块存储器传送指令
• 说明随着32位长字操作数
• 与两个或三个操作数指令读取
• 随着负载的并行存储和并行运算指令
• 条件存储指令
• 快速从中断返回
• 片上外设
 - 软件可编程等待状态发生器和可编程银行开关
 - 片内可编程锁相环回路(PLL)时钟发生器外部时钟源
 - 两个16位定时器
 - 六通道直接存储器存取(DMA)控制器
 - 三个多通道缓冲串行端口(McBSP的)
 - 8/16-Bit增强并行主机端口接口(HPI8/16)
 - 通用异步接收器/发送器(UART),带有集成波特率率发生器
• 功率IDLE1消耗控制,IDLE2和IDLE3说明随着掉电模式
• CLKOUT的关控制CLKOUT的禁用
• 片上基于扫描的仿真逻辑,IEEE标准1149.1?? (JTAG)边界扫描逻辑
• 144引脚球栅阵列(BGA)(GGU后缀)
• 144引脚小外形四方扁平封装(LQFP封装)(铂族后缀)
• 8.33 – ns单周期定点指令执行时间(120 MIPS)
• 3.3 – V的I / O电源电压
• 1.5 – V的核心供电电压

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